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DS88快速路啁啾可以直接數字5速率組成器最為關鍵的共同點 32位頻率調諧字
13位ROM相位地址解析
片上11位DAC
時鐘速率高達4.5 GHz
可在正常保持格式和歸零格式之間選擇的模擬輸出
·對于正常保持模式產生高達2.25GHz的第一奈奎斯特頻帶或對于返回到零模式產生高達6.75GHz的第三奈奎斯特頻帶。
在4 GHz時鐘速率下，寬帶最差SFDR接近50 dBC（DC到2-GHz帶寬）
50個后端的互補模擬波形輸出
同步芯片/N同步多芯片應用
SyCOOYP/N為數據加載和同步選通信號提供參考。
LVTTL/CMOS數字模式控制輸入
異步復位（RST）引腳啟動階段0（與IQSL =低）或90（與IQSL =高）啟動狀態
·頻閃輸入（STRBUP/N）以更新頻率字和DAC輸出頻率
●寬數據加載窗口允許DS878由存儲器、微控制器、FPGA或DSP芯片控制，以在頻率轉換期間不發生時鐘滑移或故障地最快更新8個時鐘周期。
4.3瓦的功耗與單-5V電源
64引腳QFN 9X9封裝形式

DS88高速啁啾直接數字頻率合成器描述
DS878是一種高速直接數字合成器（DDS），頻率調諧分辨率為32位，ROM相位分辨率為13位，DAC幅度分辨率為11位。DAC的模擬輸出可以在正常保持模式(對于第一奈奎斯特頻帶)和歸零模式(對于第一、第二和第三奈奎斯特頻帶)操作之間選擇。正弦波可以產生高達第一奈奎斯特帶近1.8 GHz（在3.6GHz時鐘速率）
正(zheng)常保持模(mo)式的DAC或高達第三奈奎斯特帶約5.4 GHz的返回到(dao)零模(mo)式的DAC。初始階段(duan)可以(yi)(yi)重置為零度開始。該芯(xin)片(pian)有一對互補模(mo)擬輸(shu)出(chu)50Ω后(hou)端。輸(shu)出(chu)波形(xing)的頻(pin)率(lv)(lv)(lv)(lv)可以(yi)(yi)由三十(shi)二個(ge)(ge)頻(pin)率(lv)(lv)(lv)(lv)控制(zhi)位(wei)(wei)控制(zhi)，VI[0:31]。DS878接(jie)受差(cha)分(fen)時(shi)鐘(zhong)輸(shu)入(ru)(ru)(ru)或單端時(shi)鐘(zhong)輸(shu)入(ru)(ru)(ru)，并(bing)且具有具有用(yong)戶定義的閾值的50-片(pian)上后(hou)端子。頻(pin)率(lv)(lv)(lv)(lv)分(fen)辨率(lv)(lv)(lv)(lv)位(wei)(wei)接(jie)受LVTTL或CMOS輸(shu)入(ru)(ru)(ru)電(dian)平。差(cha)分(fen)同(tong)步(bu)(bu)輸(shu)入(ru)(ru)(ru)SyncI_P/N為多個(ge)(ge)芯(xin)片(pian)應用(yong)提(ti)供同(tong)步(bu)(bu)，并(bing)且啟動每個(ge)(ge)芯(xin)片(pian)準(zhun)(zhun)備接(jie)受頻(pin)率(lv)(lv)(lv)(lv)字輸(shu)入(ru)(ru)(ru)。同(tong)步(bu)(bu)選通輸(shu)入(ru)(ru)(ru)由內(nei)部產生的8分(fen)頻(pin)時(shi)鐘(zhong)的過(guo)渡邊鎖存，這些時(shi)鐘(zhong)也被發送到(dao)輸(shu)出(chu)管腳SyncO_P/N。SyncO_P/N.可以(yi)(yi)用(yong)作參考來同(tong)步(bu)(bu)頻(pin)率(lv)(lv)(lv)(lv)字和選通信號輸(shu)入(ru)(ru)(ru)定時(shi)與內(nei)部分(fen)頻(pin)8cl的對準(zhun)(zhun)。鎖正(zheng)確。復位(wei)(wei)是異步(bu)(bu)的，以(yi)(yi)最小(xiao)化(hua)模(mo)擬輸(shu)出(chu)的時(shi)鐘(zhong)延遲的有效性。優化(hua)內(nei)部時(shi)序以(yi)(yi)避免頻(pin)率(lv)(lv)(lv)(lv)字過(guo)渡或復位(wei)(wei)后(hou)的時(shi)鐘(zhong)滑動。只需要一個(ge)(ge)單一的5V電(dian)源。