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MD657B是款快速12四位數模變為器（DAC），集就成了48:12（12路4:1）插入多路重復使用技術器。片上DAC可以在大于等于6.0gsps的抽樣率下事業。DAC的模似模擬放入的的可在合適保持著方式（使用一、個奈奎斯特中k線）或復位方式（使用一、個、二、和第二奈奎斯特中k線）中間的首選。差成績線詞的數據文件插入接口類型與LVPECL、LVDS和CML兼容。在48對差成績線據插入被多路重復使用技術到4倍的線速度后，16個快速的數據文件位被鎖存并標識號以驅動器DAC模擬放入的的級。相互依存模擬放入的的可與50瓦模擬放入的的后殼POS機。提高乖以4的鐘表模擬放入的的和抽樣相位的首選（SEL1和SEL2），以簡化法相對而言于插入的數據文件的抽樣相位的分散對齊。還提高了乖以8的鐘表模擬放入的的。相對 還要同歩個MD657B模擬放入的的的體統利用程序流程，提高了重制性能。

重要結構特征·DAC沒個設置位的4:1復接百分比·12位甄別率DAC獨角獸高達>6.0 Gsps濃度·DAC虛擬仿真轉換形式可在合適維持（NH）策略或復位（RZ）策略之中會選擇·帶50瓦背部終端互補性輸入輸出·提高專一性的乖以4和乖以8的石英鐘傷害中用資料同歩·2.75W耗電量·可變性400~800mvpp單端工作輸出擺幅·每差分放入的數據和歸零對之間的電源芯片上100歐姆數據終端·非常低的網絡延時：從數據統計抽樣點進行統計5-7個數字時鐘頻次或少得多·超底相位環境噪聲·LQFP包，帶裸露墊